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      符合IEEE標準的硬件描述語言有:VHDLVerilog HDL

      1、VHDL:

      特點:

      a)功能強大、設計靈活

      b)支持廣泛、易于修改

      c)強大的系統(tǒng)硬件描述能力

      d)獨立于器件的設計、與工藝無關

      e)很強的移植能力

      f)易于共享和復用

      2、Verilog HDL

      Verilog來自C 語言,易學易用,編程風格靈活、簡潔,使用者眾多,特別在ASIC領域流行;

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      知識擴展

      硬件描述語言(英文: Hardware Description Language ,簡稱: HDL )是電子系統(tǒng)硬件行為描述、結(jié)構(gòu)描述、數(shù)據(jù)流描述的語言。利用這種語言,數(shù)字電路系統(tǒng)的設計可以從頂層到底層(從抽象到具體)逐層描述自己的設計思想,用一系列分層次的模塊來表示極其復雜的數(shù)字系統(tǒng)。然后,利用電子設計自動化( EDA )工具,逐層進行仿真驗證,再把其中需要變?yōu)閷嶋H電路的模塊組合,經(jīng)過自動綜合工具轉(zhuǎn)換到門級電路網(wǎng)表。接下去,再用專用集成電路 ASIC 或現(xiàn)場可編程門陣列 FPGA 自動布局布線工具,把網(wǎng)表轉(zhuǎn)換為要實現(xiàn)的具體電路布線結(jié)構(gòu)。

      硬件描述語言 HDL 的發(fā)展至今已有 20 多年的歷史,并成功地應用于設計的各個階段:建模、仿真、驗證和綜合等。到 20 世紀 80 年代,已出現(xiàn)了上百種硬件描述語言,對設計自動化曾起到了極大的促進和推動作用。但是,這些語言一般各自面向特定的設計領域和層次,而且眾多的語言使用戶無所適從。因此,急需一種面向設計的多領域、多層次并得到普遍認同的標準硬件描述語言。 20 世紀 80 年代后期, VHDL 和 Verilog HDL 語言適應了這種趨勢的要求,先后成為 IEEE 標準。

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